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Chapter 4: Getting Started
Topic
Frame-Based
Acceleration using
Hardware Co-
Simulation
Tutorial Example -
Using System
Generator and SDK
to Co-Debug an
Embedded DSP
Design
Timing Analysis Examples
Topic
Tutorial Example:
Using the Timing
Analyzer
Description
Explains how to use frame or vector-based transfers to further
accelerate simulations using FPGA hardware co-simulation.
Integrating a processor with custom logic such as those from
DSP designs is a fairly involved process. In this tutorial example,
you will learn how to perform hardware and software co-
debugging using System Generator and the Xilinx Software
Development Kit (SDK) together.
Description
Explains how to use the System Generator Timing Analysis tool to
meet timing requirements of System Generator designs. Also
touches on techniques that may be used when a design does not
meet timing.
Miscellaneous Examples
Topic
Importing a System
Generator Design into
a Bigger System
Configurable
Subsystems and
System Generator
Integrator
Block RAM-Based
State Machines
Description
Discusses how to take the VHDL netlist from a System Generator
design and synthesize it in order to embed it into a larger design.
Also shows how VHDL created by System Generator can be
incorporated into simulation model of the overall system.
Illustrates the use of Configurable Subsystems for Simulation and
Generation.
This example uses an integrator to illustrate error analysis
capability.
Demonstrates use of Mealy State Machine block from the reference
library.
80
www.xilinx.com
System Generator for DSP Getting Started Guide
UG639 (v 13.1) March 1, 2011
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